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CMOS回路におけるタイミング歩留り最大化のためのゲートサイジング手法の提案 (集積回路)

CMOS回路におけるタイミング歩留り最大化のためのゲートサイジング手法の提案 (集積回路)
紙記事
坂本 良太, 室山 真徳, 石原 亨 他<Z16-940>電子情報通信学会技術研究報告 = IEICE technical report : 信学技報106(550) 2007.3.7p.67～72
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CMOS回路におけるタイミング歩留り最大化のためのゲートサイジング手法の提案 (VLSI設計技術)

CMOS回路におけるタイミング歩留り最大化のためのゲートサイジング手法の提案 (VLSI設計技術)
紙記事
坂本 良太, 室山 真徳, 石原 亨 他<Z16-940>電子情報通信学会技術研究報告 = IEICE technical report : 信学技報106(547) 2007.3.7p.67～72
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CMOS回路におけるタイミング歩留り最大化のためのゲートサイジング手法の提案

CMOS回路におけるタイミング歩留り最大化のためのゲートサイジング手法の提案
デジタル文書・図像類
坂本, 良太, 室山, 真徳, 石原, 亨, 安浦, 寛人電気情報通信学会2007-03電子情報通信学会技術研究報告, VLD2006-208p.67-72
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